Vereinigte Staaten
Skyline Scientific Inc
Retym
Verification Technical-Lead Engineer
Vereinigte Staaten
Austin, Texas, Vereinigte Staaten
Python
Automatische Übersetzung. Prüfe das Original.
Über die Stelle
Für ein spannendes, gut finanziertes Startup, das Spitzentechnologie für die nächste Generation der Hochgeschwindigkeitskommunikation entwickelt, suchen wir einen Verification Team-Leader, der sich in die komplexe RTL-Design-Verifikationsaktivität in verschiedenen Designaspekten einbringt.
Anforderungen
Hauptverantwortlichkeiten
- Führung, Mentoring und Management eines Teams von Verifikationsingenieuren, um Projektmeilensteine und Lieferungen zu erreichen.
- Definition und Ausführung von Verifikationsstrategien und -plänen für komplexe digitale Blöcke und Systeme.
- Überwachung der Entwicklung robuster und wiederverwendbarer Verifikationsumgebungen unter Verwendung von SystemVerilog und UVM.
- Überprüfung und Genehmigung von Verifikationsplänen, Testbenches und Abdeckungsmetriken.
- Steuerung der funktionalen und abdeckungsbasierten Verifikation über mehrere Block-/Systemverifikationszyklen hinweg.
- Zusammenarbeit mit Designingenieuren zur Fehlersuche und Behebung von Funktionalitätsproblemen.
- Sicherstellung einer effektiven Ressourcenzuweisung und Projektplanung zur Erzielung optimaler Ergebnisse.
- Förderung einer Kultur der technischen Exzellenz, des kontinuierlichen Lernens und der Innovation innerhalb des Teams.
- Berichterstattung über den Verifikationsfortschritt, Probleme und Risiken an das Senior Management und andere Stakeholder.
Mindestanforderungen
Erforderliche Qualifikationen
- 10+ Jahre Erfahrung in der digitalen Designverifikation – ein Muss.
- 3+ Jahre Erfahrung in der Verwaltung oder Leitung von Verifikationsteams.
- Nachgewiesene Erfolgsbilanz bei der Durchführung von zwei oder mehr vollständigen Block-/Systemverifikationszyklen.
- Tiefgreifende Kenntnisse von VLSI-Verifikationsabläufen, Konzepten, Methoden und Schnittstellen mit algorithmischen Modellen und SW.
- Expertise in der Verifikation mit SystemVerilog, UVM oder anderen branchenüblichen Methoden (eRM, OVM).
- Erfahrung auf Block-, Cluster- und Full-Chip-Verifikationsebene.
- Starke Problemlösungsfähigkeiten und die Fähigkeit, komplexe Funktionalitätsprobleme zu debuggen.
- Ausgezeichnete Führungs-, Kommunikations- und Organisationsfähigkeiten zur Verwaltung und Inspiration eines Teams.
Bevorzugte Qualifikationen
- Praktische Erfahrung mit Hochgeschwindigkeitskommunikationsprotokollen wie Ethernet, PCIe oder SerDes.
- Kenntnisse in Skriptsprachen (z. B. Python, Perl) zur Automatisierung von Verifikationsprozessen.
- Vertrautheit mit formalen Verifikationstechniken und -werkzeugen.
- Hintergrund in System-Level-Verifikation oder Post-Silicon-Validierung.
- Erfahrung mit Projektplanungswerkzeugen und -methoden für effektives Teammanagement.
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