Alemania
Chainguard
Ciena
Ingeniero de Verificación de ASIC DSP - Sistemas de Transmisión Óptica
Alemania
Brunswick, Lower Saxony, Alemania
PythonC++
Traducción automática. Consulta el original.
Sobre la oportunidad
Como líder mundial en conectividad de alta velocidad, Ciena está comprometido con un enfoque centrado en las personas. Nuestros equipos disfrutan de una cultura centrada en priorizar un entorno de trabajo flexible que fomente el crecimiento individual, el bienestar y la pertenencia. Somos una empresa tecnológica que lidera con nuestra humanidad, impulsando nuestras prioridades comerciales junto con un impacto social, comunitario y societal significativo.
La familia de productos WaveLogic de Ciena es un componente central de las soluciones de transmisión óptica, que permite redes de telecomunicaciones de alto rendimiento a nivel mundial. Este puesto contribuye a la validación y calidad de estos productos a través de una rigurosa verificación digital. La posición juega un papel crítico para garantizar la funcionalidad fiable en subsistemas y componentes arquitectónicos complejos.
En Ciena, estamos comprometidos a construir y fomentar un entorno en el que nuestros empleados se sientan respetados, valorados y escuchados. Ciena valora la diversidad de su fuerza laboral y respeta a sus empleados como individuos. No toleramos ninguna forma de discriminación.
Ciena es un Empleador de Igualdad de Oportunidades, que incluye a personas con discapacidad y veteranos protegidos.
CÓMO MARCARÁS LA DIFERENCIA
- Diseñar y ejecutar actividades de verificación para bloques funcionales arquitectónicos dentro de la familia de productos WaveLogic
- Analizar las especificaciones de arquitectura y requisitos funcionales y colaborar con ingenieros de sistemas y arquitectos
- Desarrollar e implementar estrategias de validación utilizando simulación, métodos formales y técnicas de cobertura
- Crear e integrar entornos de verificación que incluyan bancos de pruebas, agentes, tableros de puntuación y escenarios de prueba utilizando SystemVerilog UVM y/o C
- Definir e implementar modelos de cobertura funcional y contribuir a la planificación de la verificación
- Realizar verificación impulsada por cobertura, analizar resultados de regresión y depurar fallos en colaboración con ingenieros de diseño
- Informar sobre el progreso de la verificación, los problemas y las actualizaciones de estado de forma regular.
LOS IMPRESCINDIBLES
- Educación: Máster en Ingeniería Eléctrica, Ingeniería Informática, Informática u otra disciplina científica aplicable
- Experiencia: 3+ años de experiencia en verificación de diseño digital de circuitos complejos
- Aplicación de SV-UVM, SVA y C++ en entornos de verificación
- Creación de planes de verificación basados en especificaciones funcionales y arquitectónicas
- Desarrollo de entornos de verificación utilizando SV-UVM y C++
- Aplicación de métodos de verificación basados en métricas, incluida la cobertura funcional
- Utilización de herramientas y flujos de verificación EDA de los principales proveedores.
- Los candidatos deben tener buenas habilidades de comunicación en inglés, sólidas capacidades de resolución de problemas y demostrar un alto nivel de motivación con la capacidad de trabajar de forma independiente.
VALORABLE
- Experiencia: Experiencia con métodos de verificación formal
- Experiencia: Experiencia con arquitecturas DSP coherentes
- Experiencia: Experiencia con estándares y protocolos como OTN/FlexO/B100G y Ethernet (100GE+)
- Experiencia: Experiencia utilizando GIT para la gestión de código fuente y el seguimiento de revisiones
- Experiencia: Experiencia utilizando Jira para la planificación de horarios, el seguimiento de asignaciones y la notificación de errores
- Aplicación de lenguajes de programación como Python, Make, Bash, C y C++
- Habilidades básicas de comunicación en alemán.
#LI-MP2
Si se le contacta en relación con una oportunidad de empleo, por favor informe a Ciena de cualquier medida de adaptación que pueda necesitar.
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