États-Unis
Wonderschool
Altera
Ingénieur Compilateur FPGA (Placer)
États-Unis
San Jose, California, États-Unis
PythonC++
Traduction automatique. Consultez l’original.
DÉTAILS DU POSTE
Nous utilisons l'intelligence artificielle pour filtrer, évaluer ou sélectionner les candidats pour le poste. Les candidats doivent être éligibles à toutes les autorisations d'exportation américaines requises.
#CG-1
TYPE DE POSTE : Permanent
HORAIRE : Horaire 1 (États-Unis d'Amérique)
LIEU PRINCIPAL : San Jose, Californie, États-Unis
LIEUX SUPPLÉMENTAIRES :
DÉCLARATION DE PUBLICATION
Tous les candidats qualifiés recevront une considération pour l'emploi sans distinction de race, de couleur, de religion, de croyance religieuse, de sexe, d'origine nationale, d'ascendance, d'âge, de handicap physique ou mental, de condition médicale, d'informations génétiques, de statut militaire et d'ancien combattant, de statut matrimonial, de grossesse, de genre, d'expression de genre, d'identité de genre, d'orientation sexuelle, ou de toute autre caractéristique protégée par la loi, la réglementation ou l'ordonnance locale.
DESCRIPTION DU POSTE
À propos d'Altera
Chez Altera™, notre indépendance en tant que plus grand fournisseur mondial de solutions FPGA pures nous confère la concentration, la vitesse et l'agilité nécessaires pour innover sans compromis. Forts de plus de quatre décennies d'expertise de pointe dans le domaine des FPGA, notre mission unique est de fournir les technologies programmables qui aident les clients à se différencier, à innover et à évoluer sur des marchés en évolution rapide tels que l'IA, le cloud, les réseaux et l'edge. En tant qu'entreprise indépendante, nous agissons plus rapidement, investissons plus profondément et collaborons plus étroitement, permettant à nos équipes de stimuler des innovations révolutionnaires et de façonner l'avenir de l'industrie des FPGA.
Aperçu du poste
Altera est un leader de l'innovation FPGA, fournissant des solutions programmables qui alimentent les applications d'IA, de cloud computing, de réseaux et d'edge. Nos équipes de compilateurs et d'outils sont essentielles pour permettre aux clients de mapper efficacement des conceptions complexes sur des architectures FPGA avancées.
Altera recherche un Ingénieur Compilateur FPGA (Placer) pour rejoindre notre équipe Compilateur à San Jose, CA. Ce rôle se concentre sur le développement et l'optimisation des algorithmes de placement FPGA au sein de la chaîne d'outils du compilateur, impactant directement les performances, l'efficacité énergétique et la qualité globale de la conception.
Le candidat idéal possède une solide expertise en algorithmes EDA, en optimisation de systèmes à grande échelle et en flux de conception physique FPGA/ASIC, ainsi qu'une passion pour la résolution de problèmes complexes et critiques en matière de performance.
Pourquoi rejoindre Altera ?
- Travailler sur la technologie de base du compilateur qui a un impact direct sur les performances et la convivialité des FPGA
- Résoudre des problèmes algorithmiques complexes à grande échelle
- Collaborer avec des équipes de classe mondiale dans les domaines de l'architecture, du silicium et du logiciel
Responsabilités clés
- Développement d'algorithmes de placement : Concevoir, implémenter et améliorer les algorithmes de placement FPGA pour optimiser le timing, la congestion et l'utilisation des ressources.
- Amélioration du flux du compilateur : Contribuer au flux de compilation FPGA de bout en bout, en travaillant en étroite collaboration avec les équipes de routage, de synthèse et de timing.
- Optimisation des performances : Améliorer les performances d'exécution, la scalabilité et la qualité des résultats (QoR) pour les conceptions clients complexes et volumineuses.
- Placement piloté par le timing : Développer et affiner les stratégies de placement conscientes du timing pour prendre en charge les conceptions critiques en performance et à haute fréquence.
- Collaboration interfonctionnelle : Collaborer avec les équipes d'architecture, de routage et de STA pour aligner les stratégies de placement sur les capacités et les contraintes des dispositifs FPGA.
- Débogage et analyse : Analyser la qualité du placement, les points chauds de congestion et les goulots d'étranglement de timing ; piloter les améliorations pour la convergence et la clôture de conception.
- Intégration de la chaîne d'outils : Intégrer de nouvelles capacités de placement dans l'infrastructure du compilateur et valider sur divers workloads.
Salaire
La fourchette de rémunération ci-dessous s'applique uniquement à la région de la Baie de Californie. Le salaire réel peut varier en fonction d'un certain nombre de facteurs, notamment l'emplacement du poste, les connaissances, les compétences, l'expérience, la formation, etc. Nous proposons également des opportunités d'incitation qui récompensent les employés en fonction de leurs performances individuelles et de celles de l'entreprise.
$149.1K - $215.9K USD
Prérequis
QUALIFICATIONS
Qualifications minimales
- Licence ou Master en génie électrique, génie informatique, informatique ou domaine connexe.
- 6+ années d'expérience en CAD FPGA/ASIC, outils EDA ou domaines connexes.
- Expérience en algorithmes et structures de données (optimisation, théorie des graphes, heuristiques)
- Expérience des algorithmes de placement ou des flux de conception physique
- Expérience en C/C++ et en bonnes pratiques d'ingénierie logicielle
- Expérience des techniques de placement (placement analytique, recuit simulé, partitionnement, clustering)
- Expérience de l'optimisation pilotée par le timing et la congestion
- Expérience des méthodologies de conception physique ASIC ou FPGA
- Expérience dans la résolution de problèmes d'optimisation complexes à grande échelle avec des exigences élevées en matière de performance et de scalabilité.
Qualifications préférées
- Expérience avec les chaînes d'outils FPGA (par exemple, Quartus, Vivado)
- Connaissance des architectures FPGA et des tissus d'interconnexion
- Familiarité avec les techniques de routage et de clôture de timing
- Expérience des algorithmes parallèles ou distribués pour les outils EDA
- Expérience en scripting (par exemple, Python, Tcl) pour l'outillage et l'automatisation
Plus d’opportunités avec un seul profil
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