États-Unis
Wonderschool
Meta
Ingénieur ASIC, Vérification de Conception
États-Unis
Austin, Texas, États-Unis · Sunnyvale, California, États-Unis
PythonC++
Traduction automatique. Consultez l’original.
À propos du poste
L'équipe Infrastructure Silicon de Meta recherche un Ingénieur Vérification ASIC Principal (Staff) pour piloter la stratégie et l'exécution de la vérification pour les circuits intégrés personnalisés qui alimentent l'infrastructure de centre de données de Meta. Dans ce rôle, vous dirigerez la vérification de bout en bout de blocs IP et de SoC complexes conçus pour les charges de travail d'accélération IA/ML, de mise en réseau et de traitement vidéo. Vous architecturerez des environnements de vérification évolutifs basés sur UVM, définirez des modèles de couverture et collaborerez avec les équipes de conception, d'émulation et de validation post-silicium pour obtenir un succès de première passe de silicium sur le portefeuille ASIC d'infrastructure de Meta.
Responsabilités
- Définir et mettre en œuvre des plans de vérification IP/SoC, construire des bancs de test de vérification pour permettre la vérification au niveau IP/sous-système/SoC
- Développer des tests fonctionnels basés sur le plan de test de vérification
- Piloter la vérification de conception jusqu'à sa clôture en fonction des métriques de vérification définies dans le plan de test, de la couverture fonctionnelle et de la couverture de code
- Déboguer, identifier la cause racine et résoudre les défaillances fonctionnelles dans la conception, en partenariat avec l'équipe de conception
- Collaborer avec des équipes interfonctionnelles telles que les équipes de conception, de modèle, d'émulation et de validation silicium pour garantir la plus haute qualité de conception
- Développer et piloter des améliorations continues de la vérification de conception en utilisant les dernières méthodologies, outils et technologies de vérification de l'industrie
Qualifications minimales
- Diplôme de licence en informatique, en ingénierie informatique, dans un domaine technique pertinent, ou expérience pratique équivalente
- 8+ années d'expérience pratique dans la méthodologie SystemVerilog/UVM et/ou la vérification basée sur C/C++
- 8+ années d'expérience dans la vérification au niveau IP/sous-système et/ou SoC basée sur les méthodologies SystemVerilog UVM/OVM
- Expérience dans un ou plusieurs des domaines suivants en plus de la vérification fonctionnelle : assertions SV, formelle, émulation
- Expérience des outils EDA et des scripts (Python, TCL, Perl, Shell) utilisés pour construire des outils et des flux pour les environnements de vérification
- Expérience dans l'architecture et la mise en œuvre de l'infrastructure de vérification de conception et dans l'exécution du cycle de vérification complet
Qualifications préférées
- Expérience avec les sous-systèmes de calcul et/ou de mémoire et/ou la vérification fonctionnelle et de performance collective
- Expérience avec la vérification de sous-systèmes ou de SoC basés sur ARM/RISC-V/GPU
- Expérience dans le développement d'environnements de vérification basés sur UVM à partir de zéro
- Expérience préalable avec des projets d'intégration au niveau du chip complet ou du package
- Expérience de travail et d'établissement de relations avec des équipes interfonctionnelles de conception, de modèle et d'émulation
- Connaissance des concepts hôtes et système pour la vérification fonctionnelle
- Expérience avec les architectures basées sur chiplets et la vérification d'intégration au niveau du package
$178,000/an à $250,000/an + bonus + actions + avantages sociaux
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