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Ingeniero de Diseño Digital (Recién Graduado)
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LA EMPRESA
).
EL PUESTO
Buscamos un Ingeniero de Diseño Digital recién graduado, con talento y motivación, para unirse a nuestro equipo y contribuir al diseño y verificación de IP digital y de señal mixta para nuestras soluciones de chiplet, incluyendo lógica PCS (Physical Coding Sublayer) e interfaces personalizadas de alta velocidad como UCIe, Ethernet y PCIe. Trabajando junto a ingenieros digitales y analógicos experimentados, escribirás RTL, construirás bancos de pruebas y modelos de comportamiento, y verás cómo tu trabajo se integra en el silicio del cliente. Este puesto es ideal para recién graduados con una base sólida en diseño digital que deseen aprender rápidamente mediante trabajo práctico en un equipo pequeño y de alto impacto.
Responsable de contratación: Christian Borelli linkedin.com/in/borellichristian/, Fundador y CSO.
NUESTRA CULTURA
Somos un equipo totalmente remoto de unas 45 personas distribuidas por el Reino Unido, Armenia, Italia, EE. UU., Estonia, India y otros lugares. ¡Creemos que el gran talento está en todas partes!
- Nuestros valores son nuestra estrella polar: Crecemos juntos, Ganamos juntos. La excelencia construye relaciones. La confianza es nuestra moneda. Los resultados importan, pero las personas los crean.
- Conectados, incluso en remoto: Invertimos intencionadamente en mantenernos conectados a través de reuniones generales regulares, 1:1s, revisiones técnicas y charlas informales de café, para que la colaboración se sienta natural y humana a pesar de la distancia.
- Alta responsabilidad, impacto real: Todos contribuyen directamente a la IP orientada al cliente. Tu trabajo no desaparece en capas de gestión: se envía.
- Cómo trabajamos: Nos movemos rápido pero con reflexión, nos comunicamos abiertamente y equilibramos la autonomía con el apoyo. Las decisiones técnicas se debaten abiertamente y se basan en datos, compromisos y pensamiento de primeros principios.
RESPONSABILIDADES CLAVE
- Diseño RTL: Diseñar e implementar bloques digitales para IP de PCS e interfaces (por ejemplo, codificadores/decodificadores, codificadores aleatorios, generadores/verificadores PRBS, FIFOs, lógica CDC, máquinas de estado de control y calibración) en Verilog/SystemVerilog, bajo la supervisión de diseñadores senior.
- Estándares y especificaciones: Estudiar los estándares de SerDes y UCIe y los documentos de arquitectura, y ayudar a convertirlos en especificaciones claras a nivel de bloque.
- Verificación: Construir bancos de pruebas y ejecutar simulaciones para verificar tus diseños, utilizando SystemVerilog, UVM o cocotb, y ayudar a desarrollar planes de verificación y cobertura.
- Modelado de señal mixta: Escribir modelos de comportamiento de bloques analógicos en Verilog/SystemVerilog (y Verilog-A cuando sea necesario) para respaldar la simulación de señal mixta y de nivel superior con el equipo analógico.
- Soporte de implementación: Obtener experiencia en síntesis, lint, comprobaciones CDC y análisis estático de temporización, y aprender cómo las decisiones de diseño afectan a la potencia, el rendimiento y el área.
- Scripting y automatización: Utilizar scripting (por ejemplo, Python, TCL o shell) para automatizar flujos de simulación, regresión e informes.
- Documentación y procesos: Documentar tus diseños y resultados de pruebas con claridad, y aportar ideas para mejorar nuestros entornos y procedimientos de diseño y verificación.
- Colaboración: Trabajar estrechamente con un equipo experimentado de ingenieros digitales, analógicos y de layout en productos como UCIe, Ethernet y PCIe.
LO QUE BUSCAMOS
Habilidades técnicas imprescindibles
- Grado o Máster en Ingeniería Eléctrica, Ingeniería Informática o un campo relacionado (se aceptan recién graduados y aquellos que se gradúen en los próximos 6 meses)
- 0–2 años de experiencia en diseño digital, incluyendo prácticas, estancias o proyectos universitarios
- Sólida comprensión de los fundamentos de la lógica digital: diseño síncrono, máquinas de estado finito, temporización, segmentación (pipelining) y cruce de dominios de reloj
- Experiencia práctica escribiendo RTL en Verilog o SystemVerilog, a través de cursos, tesis, proyectos de FPGA o prácticas
- Experiencia con un simulador HDL (por ejemplo, Xcelium, VCS, Questa o herramientas de código abierto como Verilator o Icarus)
- Excelentes habilidades de resolución de problemas y atención al detalle
Habilidades blandas y profesionales
- Comunicación clara y estructurada en inglés profesional: capaz de explicar resultados complejos de forma concisa
- Mentalidad colaborativa y orientada a la retroalimentación
- Capacidad demostrada para asesorar y guiar a ingenieros con menos experiencia
- Fuerte sentido de propiedad, fiabilidad y seguimiento de tareas
- Actitud curiosa y automotivada, con ganas de aprender y explorar nuevas herramientas o métodos
- Alto nivel de integridad y profesionalidad al representar a la empresa y manejar información confidencial.
Se valorará
- Exposición a metodologías de verificación como UVM, aserciones de SystemVerilog o cocotb
- Conocimientos básicos de síntesis, análisis estático de temporización o place-and-route
- Familiaridad con interfaces o protocolos serie de alta velocidad (por ejemplo, UCIe, Ethernet, PCIe) o codificación de línea (por ejemplo, 8b/10b, 64b/66b)
- Conocimiento de conceptos de Diseño para Pruebas (scan, BIST) y codesarrollo hardware/software
- Habilidades de scripting en Python, TCL o shell, y comodidad en un entorno Linux
- Experiencia en prototipado con FPGA
Habilidades blandas y profesionales
- Comunicación clara y estructurada en inglés profesional: capaz de explicar tu trabajo de forma concisa
- Mentalidad colaborativa y orientada a la retroalimentación, abierta a aprender de las revisiones de diseño
- Fuerte sentido de propiedad, fiabilidad y seguimiento de tareas
- Actitud curiosa y automotivada, con ganas de aprender y explorar nuevas herramientas o métodos
- Alto nivel de integridad y profesionalidad al representar a la empresa y manejar información confidencial.
POR QUÉ UNIRTE A NOSOTROS
- Flexibilidad de trabajo remoto: trabaja desde cualquier lugar, con horario flexible
- Equipo y configuración: te proporcionaremos las herramientas que necesitas para tener éxito
- Proyectos de alto impacto: diseña IP digital y de señal mixta real utilizada en el silicio del cliente, desde tus primeros meses
- Mentoría desde el primer día: un responsable dedicado e ingenieros experimentados que revisarán tu trabajo y te ayudarán a crecer
- Compensación competitiva y transparente: ajustada a tu ubicación y modelo de compromiso
- Aprendizaje y crecimiento: incorporación estructurada, sesiones de IA–DLP, inmersiones técnicas y intercambio de conocimientos dirigido por compañeros que desarrollan tanto la profundidad técnica como la perspectiva a nivel de sistema
PROCESO DE SELECCIÓN
- Llamada con el fundador (30 min): presentación mutua y alineación de intereses
- Entrevista técnica (90 min): fundamentos, razonamiento y resolución de problemas
- Opcional: Segunda entrevista técnica (60 min): otra inmersión profunda en temas específicos, que podría incluir una presentación sobre la que te informaremos con antelación
- Llamada de RR. HH. y cultura (45 min): valores, estilo de colaboración y formas de trabajar
- Oferta y próximos pasos: enviamos la oferta e iniciamos el proceso de incorporación.
Aviso legal: Este es nuestro proceso estándar para la mayoría de los puestos. Para puestos más senior, especializados o de mayor autoridad, nos reservamos el derecho de modificar o adaptar estos pasos según consideremos oportuno.
Si no cumples con todos los requisitos pero te entusiasma el puesto, envía tu solicitud de todos modos. Valoramos la curiosidad, la integridad y el potencial tanto como la experiencia.
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